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厂商介绍

Cadence

  • 成立时间1988
  • 总部位于美国加州圣何塞
  • 现拥有员工约4800
  • 股票代码CDNS(纳斯达克),市值31.7亿美元

一、我们提供以下主打产品系列

  • Allegro PCB
  • OrCAD PCB

二、你知道吗?

  • 全球知名半导体与电子系统公司均将Cadence软件作为其设计标准
  • 自1991年以来,Cadence已连续在国际EDA市场中销售业绩稳居第一

三、应用领域

  • 服务于全球2万亿电子市场,包括超过3000亿的半导体市场

产品列表

型号
产品描述
RoHS
文档
 
将低功耗技术流程组成一个有机的系统,并优化其具体应用于。从而通过完整的前端到后端方法学,最佳的实践,检测表和参考流程来消除低功耗设计的风险。
该Cadence VIP产品提供了业界最广泛的复杂协议验证IP选择,其中包括超过15,000内存模型
Drives verification closure using incrementally developed assertion and test list plans. Captures and quickly prioritizes failures.
自动化和指导日常验证任务和结果的可视化。
自动指导验证过程从计划到收敛的整个过程,也包含Systemverilog和e的功能覆盖率统计和分析。
支持多语言,涵盖人系统级到门级的覆盖率驱动的功能验证,分析,纠错流程,并支持验证环境的自动生成。
通过自动化测试平台的产生和重用来提高模块,芯片和系统验证的质量与效率。
通过紧密集成的形式分析和仿真双引擎,Incisive Enterprise Verifier大大 加速设计初期进程,使早期就能发现设计错误,确保了深层错误的发现,使用更多的SVA和PSL覆盖率指标来实现验证的收敛,并通过基于断言的验证增加投资回报率
在验证环境可用之前,通过基于断言的验证进行形式化分析,检查RTL模块设计,来加速设计的收敛
Steers verification with a system of best practices and optimized methods. Spans the full verification process, from creating automated, executable plans to achieving system-level closure.
自动化和简化了可重复使用的先进的验证技术的采用,提高效率和可预见性。使用交互式研讨会和集成的Incisive工具流程来学习掌握指标驱动验证方法学。
Facilitates true SystemVerilog interoperability with a standard library and a proven methodology. Eases the development and usage of plug-and-play verification IP.
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